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Controls and Indicators
4.1
DIP Switch Settings
Figure 4-1 shows the location of the DIP switches on the board and their default (factory) position.
Table 4-1 describes the possible settings of all DIP switches on the boards. Note that when in the “ON”
position, the value of the switch is zero. For a detailed description of the bits and fields, refer to the
Section 4.4.3, “Power-On Reset Configuration” in the MPC8572E PowerQUICC? III Integrated Host
Processor Family Reference Manual, Revision 2.
Table 4-1. MPC8572EAMC DIP Switch Listing
Feature
SW4.1
SW4.2
SW4.3
SW4.4
Default Settings
[OFF = 1, ON = 0)
OFF
OFF
OFF
ON
Comments
SW4
Reserved
Reserved
Reserved
[SW4.4] = MMC H/W Select. ON—MMC present 1
[SW4.4] = MMC H/W Select. OFF—MMC not present
SW5
SW5.1
SW5.2
SW5.3
SW5.4
SW5.5
SW5.6
SW5.7
SW5.8
ON
OFF
OFF
ON
OFF
ON
OFF
OFF
[SW5.1:2] =
[SW5.1:2] =
[SW5.1:2] =
[SW5.1:2] =
[SW5.3:4] =
[SW5.3:4] =
[SW5.3:4] =
[SW5.3:4] =
[SW5.5:6] =
[SW5.5:6] =
[SW5.5:6] =
[SW5.5:6] =
[SW5.7:8] =
[SW5.7:8] =
[SW5.7:8] =
[SW5.7:8] =
ON:ON. CCB:SYSCLK = 4:1 (266 MHz)
OFF:ON. CCB:SYSCLK = 8:1 (533 MHz)
ON:OFF. CCB:SYSCLK = 10:1 (666 MHz) 1
OFF:OFF. CCB:SYSCLK = 12:1 (800 MHz)
ON:ON. e500 Core #0:CCB = 1.5:1
OFF:ON. e500 Core #0:CCB = 2:1 1
ON:OFF. e500 Core #0:CCB = 2.5:1
OFF:OFF. e500 Core #0:CCB = 3.5:
ON:ON. e500 Core #1:CCB = 1.5:1
OFF:ON. e500 Core #1:CCB = 2:1 1
ON:OFF. e500 Core #1:CCB = 2.5:1
OFF:OFF. e500 Core #1:CCB = 3.5:1
ON:ON. Boot ROM Location = PCI-Express
OFF:ON. Boot ROM Location = Serial RapidIO
ON:OFF. Boot ROM Location = DDR Memory
OFF:OFF. Boot ROM Location = 32-bit Local FLASH Memory 1
SW500
SW500.1
SW500.2
SW500.3
4-2
ON
ON
OFF
[SW500.1:3]=ON:ON:ON.DDR Clock Ratio = 3:1 DDRCLK (200 MHz)
[SW500.1:3]=OFF:ON:ON.DDR Clock Ratio = 4:1 DDRCLK (266 MHz)
[SW500.1:3]=ON:OFF:ON.DDR Clock Ratio = 6:1 DDRCLK (400 MHz)
[SW500.1:3]=OFF:OFF:ON.DDR Clock Ratio = 8:1 DDRCLK (533 MHz)
[SW500.1:3]=ON:ON:OFF.DDR Clock Ratio = 10:1 DDRCLK (666 MHz) 1
[SW500.1:3]=OFF:ON:OFF.DDR Clock Ratio = 12:1 DDRCLK (800 MHz)
[SW500.1:3]=ON:OFF:OFF. RESERVED
[SW500.1:3]=OFF:OFF:OFF.DDR Clock Ratio = SYNCHRONOUS
MPC8572EAMC Advanced Mezzanine Card User Guide, Rev. 1.2
Freescale Semiconductor
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